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집 - 강진터미널 7:30 집출발 9:00 고터역도착 9:30 센트럴시티 터미널 출발 12:40 전북강진 터미널 도착 강진터미널 - 섬진강인증센터 http://kko.to/xzORVmexJO 자전거 길찾기 '강진공용버스터미널'에서 '섬진강댐 인증센터'까지 map.kakao.com 1일차 오후 (56km, 섬진강댐 인증센터 - 섬진강 기차마을) 13:30 섬진강댐 인증센터 ---16km--- 14:30 장군목 인증센터 15:00 장군목 인증센터 ---20km--- 16:00 향가유원지 인증센터 16:30 향가유원지 인증센터 ---20km--- 17:30 섬진강 기차마을 숙소 : http://kko.to/HKB20SQRz5 자전거 길찾기 '섬진강댐 인증센터'에서 '곡성섬진강기차마을'까지 map.kakao.c..
ISCA (International Symposium on Computer Architecture) ISCA 50 (June, 2023, Orlando, USA) paper due 끝남 (2022. 11. 14 Abstract Deadline) 2022 Industry Session The Mozart Reuse Exposed Dataflow Processor for AI and Beyond SimpleMachines Software-Hardware Co-design for Fast and Scalable Training of Deep Learning Recommendation Models Meta AI Accelerator on IBM Telum Processor IBM Fidas: Fortifying..
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Digital image processing이란, image를 digital computing으로 가공(processing)하는 방법론에 관한 학문이다. 먼저 Processing은 1) Input을 2) 어떤 system(=function, algorithm)을 통해서 3) 의도한 output을 얻는 것을 말한다. 1) Input : Image Image란? 2차원 공간 상에서 position과 value로 표현되는 유의미한 시각적 정보의 집합이다. 실제 우리가 인식하는 사물이나 필름 사진 등은 연속적인 signal로 존재한다. (우리가 흔히 아날로그라고 부름) 하지만, digital computing을 하려면 image는 digitalize되어야 한다. 즉, image의 position과 value는 ..
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아래 그림이 Synopsis사의 formality 설명 문서에 나온 순서도인데, 1) HDL로 작성한 RTL을 synthesize하면 1차 netlist가 나옴. 2) 1)에서 나온 netlist로 PnR을 진행하면 Final netlist가 나옴. 3) Synthesizer가 뱉어낸 netlist와 PnR이 완료된 Final netlist를 비교하여 각 net이 동일하게 생성되었는지, 즉 Verilog로 서술했던 functionality와 netlist로 구현된 design이 정확히 같은 동작을 하는지 확인함.
- Ben : Freud said, "love and work. Work and love. That's all there is." Well, I'm retired, and my wife is dead. As you can imagine, that's giving me some time on my hands. My wife's been gone for three-and-a-half years, and I miss her in every way. And, retirement? That is an ongoing, relentless effort in creativity. At first, I admit, I enjoyed the novelty of it. sort of felt like I was playin..
1. STT (Speech To Text, Speech Recognition, 음성인식) - 사람이 말하는 음성 언어를 컴퓨터가 인식하여 그 내용을 텍스트 데이터로 전환하는 처리 과정. 내용을 이해하는 수준은 아니며 단순히 음성 데이터를 텍스트로 구현하여 시스템에 입력하는 단계. - Voice dialing, call routing, simple data entry(신용카드 번호, 전화번호 입력), word processor, DVI(Direct voice input, 전투기나 비행기 조종에서 사용됨.) speaker identification(목소리로 사용자 인식) 2. NLP (Natural Language Processing) - 사람의 언어, 즉 자연어는 기계가 이해하기에는 직관적이고 모호한 표현..
1. 중첩된 루프는 피한다 : 소프트웨어에서 루프의 처리는 그냥 행을 반복해서 연산하는 것이지만, 하드웨어 설계에서 루프는 피드백이 있는 하드웨어를 의미한다. 때문에 중첩된 루프 구조는 최적화에 바람직하지 않다, 2. 중첩된 if문은 피한다 : if문은 하드웨어에서 로직으로 구현된다. 따라서 if문이 중첩될수록 로직의 아웃풋이 다른 로직의 인풋으로 들어가면서 로직 레벨이 증가한다. 로직 레벨이 증가할수록 딜레이가 커지기 때문에 타이밍 에러가 발생할 확률이 높다. 3. if문보다는 case문- if/else의 반복도 마찬가지로 로직 레벨을 증가시킨다. case문을 쓰면 입력이 여러개인 하나의 로직을 사용하기 때문에 로직 레벨이 낮아짐. 4. 괄호 사용z
1. 디지털 집적회로 논리게이트 설계시 고려해야 할 사항 - delay 최소화, 즉 빠른 속도 : Cap 최소화, 높은 전류(=W에 비례), 작은 전압 스윙- 전력소모 : CLK 속도, Load Cap, 낮은 Vdd, 낮은 전류, Vth 낮추기(=Na, Tox)- 논리게이트의 면적 : TR 갯수, 사용되는 TR의 크기, 연결선의 간결성- Fan-in/ Fan-outㄴ Fan-In : 연결할 수 있는 맥시멈 인풋 갯수. ㄴ Fan-out : 출력값으로 구동할 수 있는 최대 게이트 갯수. 2. Static CMOS Logic Gate - 구조 및 동작 원리ㄴ Pull-up 네트워크 : Vdd와 연결되어 있으며, PMOS로 구성된다. Logic의 H값을 담당.ㄴ Pull-down 네트워크 : GND와 연결되어..
1. 집적회로의 문제점 1) Body Effect - Vds 같더라도 Vsb가 크면(즉, 드레인&소스와 바디 사이의 전압차가 커지면) -> Dep layer 넓어짐 -> Vth 커짐 2) Channel-length Modulation- (sat 영역에서) Vd가 계속 커지면 -> dep layer 두꺼워짐 -> 채널을 더 밀어냄 -> 전류식에서 베타는 게이트 길이와 반비례하는데, 채널이 짧아지면서 실질적인 게이트 길이가 줄어듬 -> 전류값 커짐 -> 즉 sat영역에서 일정하지 않고 사실은 점점 커짐. - (1+λVds)가 전류식에 추가됨- 게이트 길이 짧을수록 dep layer가 줄어드는 양에 영향을 많이 받음 -> 집적회로에서 게이트 길이 짧아질수록 CLM의 영향 커짐- CLM는 선형적으로 일어나므로 ..
1. Basic NMOS의 구조와 동작 원리 - MOSFET (Metal-Oxide Semiconductor Field-Effect Transistor) : 굳이 풀어 쓰면 금속-산화 반도체 전계 효과 트랜지스터. ㄴ MOS? : 도핑된 반도체 기판 위에 SiO2로 된 절연층과 금속이 적층되어 있는 구조를 나타내는 말이다(MOSFET 개발 초기에는 게이트를 금속 소재로 사용했지만 최근에는 공정상 편의를 위해 폴리실리콘이 사용됨). 세로 방향으로 보면 금속-유전체-p형 반도체 순서로 적층되어 있음을 볼 수 있는데 이는 capacitor의 구조와 유사하다. ㄴ FET? : 이번에는 가로 방향으로 구조를 보자. n+, 즉 고농도로 도핑된 n-type인 source와 drain 사이에 p-type인 body가 ..